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台积电公布创新芯片制造技术A16,预计2026年实现量产

作者:王富贵 来源:网络整理 发表:2024-04-26 12:40:44 我要点评 作者ID:1

台积电公布了一项创新芯片制造技术——A16,预计将于2026年实现量产。这一技术的出现无疑将给全球半导体产业带来巨大的变革。那么,A16技术究竟有何特点?它将如何改变我们...

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台积电公布了一项创新芯片制造技术——A16,预计将于2026年实现量产。这一技术的出现无疑将给全球半导体产业带来巨大的变革。

那么,A16技术究竟有何特点?它将如何改变我们的生活?未来几年内,我们能否看到搭载A16技术的电子产品问世?

[我们的技术新闻]在加州圣克拉拉举行的北美技术论坛上,世界领先的半导体制造企业台积电宣布了一个名为TSMC的项目 A16的新芯片制造技术计划于2026年大规模生产。该技术结合了领先的纳米电晶体和创新的背面电轨解决方案,预计将大大提高逻辑密度和效率。

台积电公布创新芯片制造技术A16,预计2026年实现量产

台积电此次发布的A16技术是其在芯片制造领域的重大突破。据悉,由于人工智能芯片公司的高需求,该技术的研发速度快于预期,但台积电业务发展高级副总裁Kevin Zhang没有透露具体的客户信息。市场分析人士认为,台积电A16技术的推出可能会直接挑战英特尔今年2月提出的“利用14A技术重新夺回芯片性能王座”的宣言。

除A16技术外,台积电还宣布将推出先进的N4C技术,以满足更广泛的市场应用需求。N4C技术延续了台积电现有的N4P技术,不仅晶粒成本降低8.5%,而且采用门槛较低,预计2025年实现量产。N4C技术提供了具有区域效益的基本硅智能金融和设计规则,与广泛使用的N4P技术完全兼容,为客户提供了一条轻松迁移到N4C的途径。该技术创新将为客户带来晶粒尺寸缩小和产量提高的双重优势。

台积电仍在积极研发紧凑型通用光子引擎(COUPE)技术,以应对人工智能热潮带来的数据传输爆炸性增长。COUPE技术采用SOIC-X芯片堆叠技术,将电子裸晶堆叠在光子裸晶上。与传统的堆叠方法相比,它可以实现更低的电阻和更高的能效。台积电计划于2025年完成支持小型插拔连接器的COUPE验证,然后在2026年整合COWOS包装技术,实现共同包装光学元件(Co-Packaged Optics,CPO),将光连接直接导入包装。

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